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NXP P89C51RB2

Name: P89C51RB2
Brand: NXP
Rating: 4.8 (10 reviews)

80C518-bitFlashmicrocontrollerfamily

ブランド: NXP

製造元部品 #: P89C51RB2

データシート: P89C51RB2 データシート (PDF)

パッケージ/ケース: QFP

RoHS ステータス:

在庫状況: 6,554 個、新しいオリジナル

Warranty: 1 Year Ovaga Warranty - Find Out More

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P89C51RB2 概要

DESCRIPTIONThe P89C51RB2/RC2/RD2Hxx device contains a non-volatile 16KB/32KB/64KB Flash program memory that is both parallel programmable and serial In-System and In-Application Programmable. In-System Programming (ISP) allows the user to download new code while the microcontroller sits in the application.FEATURES• 80C51 Central Processing Unit• On-chip Flash Program Memory with In-System Programming (ISP) and In-Application Programming (IAP) capability• Boot ROM contains low level Flash programming routines for downloading via the UART• Can be programmed by the end-user application (IAP)• Parallel programming with 87C51 compatible hardware interface to programmer• Six clocks per machine cycle operation (standard)• 12 clocks per machine cycle operation (optional)• Speed up to 20 MHz with 6 clock cycles per machine cycle (40 MHz equivalent performance); up to 33 MHz with 12 clocks per machine cycle• Fully static operation• RAM expandable externally to 64 kbytes• Four interrupt priority levels• Seven interrupt sources• Four 8-bit I/O ports• Full-duplex enhanced UART – Framing error detection – Automatic address recognition• Power control modes – Clock can be stopped and resumed – Idle mode – Power down mode• Programmable clock out• Second DPTR register• Asynchronous port reset• Low EMI (inhibit ALE)• Programmable Counter Array (PCA) – PWM – Capture/compare

特徴

80C51 Central Processing Unit
On-chip Flash Program Memory with In-System Programming (ISP) and In-Application Programming (IAP) capability
Boot ROM contains low level Flash programming routines for downloading via the UART
Can be programmed by the end-user application (IAP)
Parallel programming with 87C51 compatible hardware interface to programmer
Six clocks per machine cycle operation (standard)
12 clocks per machine cycle operation (optional)
Speed up to 20 MHz with 6 clock cycles per machine cycle (40 MHz equivalent performance); up to 33 MHz with 12 clocks per machine cycle
Fully static operation
RAM expandable externally to 64 kbytes
Four interrupt priority levels
Seven interrupt sources
Four 8-bit I/O ports
Full-duplex enhanced UART
– Framing error detection
– Automatic address recognition
Power control modes
– Clock can be stopped and resumed
– Idle mode
– Power down mode
Programmable clock out
Second DPTR register
Asynchronous port reset
Low EMI (inhibit ALE)
Programmable Counter Array (PCA)
– PWM
– Capture/compare

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