注文金額が
$5000A3P600-FGG484
Field Programmable Gate Array A3P600-FGG484 FPGA
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ブランド: MICROCHIP TECHNOLOGY INC
製造元部品 #: A3P600-FGG484
データシート: A3P600-FGG484 データシート (PDF)
パッケージ/ケース: FBGA-484
A3P600-FGG484 概要
The A3P600-FGG484 FPGA, a part of Microchip Technology's ProASIC3 family, is a game-changing device that redefines the possibilities in the field of programmable gate arrays. With an impressive 600,000 system gates, this FPGA delivers unmatched performance and versatility, making it ideal for applications across various industries. Thanks to its revolutionary Flash*Freeze technology, the A3P600-FGG484 boasts incredibly low static power consumption, setting a new standard for energy efficiency in programmable logic devices. The reprogrammable flash technology allows for in-system programming, providing engineers with the flexibility to optimize their designs in real-time. This FPGA comes equipped with 293 user I/Os, opening up a wide range of connectivity options and ensuring seamless integration into different systems. Supporting high-speed interfaces like SPI, I2C, and UART further enhances its adaptability. Moreover, its security features, which include non-volatile key storage and anti-tamper capabilities, demonstrate Microchip Technology's dedication to keeping sensitive data safe and secure. Whether in communications, industrial, or automotive applications, the A3P600-FGG484 offers a reliable and cost-effective solution for designs that demand moderate logic capacity and flexible programming
特徴
- High Capacity
- 15 k to 1 M System Gates
- Up to 144 kbits of True Dual-Port SRAM
- Up to 300 User I/Os
- Reprogrammable Flash Technology
- 130-nm, 7-Layer Metal (6 Copper), Flash-Based CMOS
- Process
- Live at Power-Up (LAPU) Level 0 Support
- Single-Chip Solution
- Retains Programmed Design when Powered Off
- High Performance
- 350 MHz System Performance
- 3.3 V, 66 MHz 64-Bit PCI†
- In-System Programming (ISP) and Security
- Secure ISP Using On-Chip 128-Bit Advanced
- Encryption Standard (AES) Decryption (except ARM®-
- enabled ProASIC®3 devices) via JTAG (IEEE 1532–
- compliant)†
- FlashLock® to Secure FPGA Contents
- Low Power
- Core Voltage for Low Power
- Support for 1.5 V-Only Systems
- Low-Impedance Flash Switches
- High-Performance Routing Hierarchy
- Segmented, Hierarchical Routing and Clock Structure
- Advanced I/O
- 700 Mbps DDR, LVDS-Capable I/Os (A3P250 and above)
- 1.5 V, 1.8 V, 2.5 V, and 3.3 V Mixed-Voltage Operation
- Bank-Selectable I/O Voltages—up to 4 Banks per Chip
- Single-Ended I/O Standards: LVTTL, LVCMOS 3.3 V /
- 2.5 V / 1.8 V / 1.5 V, 3.3 V PCI / 3.3 V PCI-X† and
- LVCMOS 2.5 V / 5.0 V Input
- Differential I/O Standards: LVPECL, LVDS, BLVDS, and
- M-LVDS (A3P250 and above)
- I/O Registers on Input, Output, and Enable Paths
- Hot-Swappable and Cold Sparing I/Os‡
- Programmable Output Slew Rate† and Drive Strength
- Weak Pull-Up/-Down
- IEEE 1149.1 (JTAG) Boundary Scan Test
- Pin-Compatible Packages across the ProASIC3 Family
- Clock Conditioning Circuit (CCC) and PLL†
- Six CCC Blocks, One with an Integrated PLL
- Configurable Phase-Shift, Multiply/Divide, Delay
- Capabilities and External Feedback
- Wide Input Frequency Range (1.5 MHz to 350 MHz)
- Embedded Memory†
- 1 kbit of FlashROM User Nonvolatile Memory
- SRAMs and FIFOs with Variable-Aspect-Ratio 4,608-Bit
- RAM Blocks (×1, ×2, ×4, ×9, and ×18 organizations)†
- True Dual-Port SRAM (except ×18)
- ARM Processor Support in ProASIC3 FPGAs
- M1 and M7 ProASIC3 Devices—Cortex-M1 and
- CoreMP7 Soft Processor Available with or without
仕様
パラメータ | 価値 | パラメータ | 価値 |
---|---|---|---|
Rohs Code | Yes | Part Life Cycle Code | Active |
Ihs Manufacturer | MICROCHIP TECHNOLOGY INC | Package Description | 23 X 23 MM, 2.23 MM HEIGHT, 1 MM PITCH, GREEN, FBGA-484 |
Reach Compliance Code | compliant | HTS Code | 8542.39.00.01 |
Factory Lead Time | 52 Weeks | Samacsys Manufacturer | Microchip |
Clock Frequency-Max | 350 MHz | JESD-30 Code | S-PBGA-B484 |
JESD-609 Code | e1 | Length | 23 mm |
Moisture Sensitivity Level | 3 | Number of CLBs | 13824 |
Number of Equivalent Gates | 600000 | Number of Terminals | 484 |
Operating Temperature-Max | 85 °C | Operating Temperature-Min | |
Organization | 13824 CLBS, 600000 GATES | Package Body Material | PLASTIC/EPOXY |
Package Code | BGA | Package Shape | SQUARE |
Package Style | GRID ARRAY | Peak Reflow Temperature (Cel) | 250 |
Programmable Logic Type | FIELD PROGRAMMABLE GATE ARRAY | Qualification Status | Not Qualified |
Seated Height-Max | 2.44 mm | Supply Voltage-Max | 1.575 V |
Supply Voltage-Min | 1.425 V | Supply Voltage-Nom | 1.5 V |
Surface Mount | YES | Technology | CMOS |
Temperature Grade | COMMERCIAL | Terminal Finish | TIN SILVER COPPER |
Terminal Form | BALL | Terminal Pitch | 1 mm |
Terminal Position | BOTTOM | Time@Peak Reflow Temperature-Max (s) | 30 |
Width | 23 mm |
配送
配送タイプ | 配送料 | リードタイム | |
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DHL | $20.00-$40.00 (0.50 KG) | 2-5 日々 |
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フェデックス | $20.00-$40.00 (0.50 KG) | 2-5 日々 |
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UPS | $20.00-$40.00 (0.50 KG) | 2-5 日々 |
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TNT | $20.00-$40.00 (0.50 KG) | 2-5 日々 |
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EMS | $20.00-$40.00 (0.50 KG) | 2-5 日々 |
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登録された航空便 | $20.00-$40.00 (0.50 KG) | 2-5 日々 |
処理時間:送料は地域や国によって異なります。
支払い
支払条件 | ハンドフィー | |
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電信送金 | 銀行手数料 US$30.00 を請求します。 |
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ペイパル | 4.0%のサービス料がかかります。 |
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クレジットカード | 3.5%のサービス料がかかります。 |
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ウエスタンユニオン | charge US.00 banking fee. |
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送金サービス | 銀行手数料は 0.00 米ドルかかります。 |
保証
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2.受け取った商品の一部が完璧な品質ではない場合、当社は責任を持って返金または交換を手配します。 ただし、商品は元の状態のままでなければなりません。
パッキング
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ステップ1 :製品
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ステップ2 :真空包装
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ステップ3 :静電気防止袋
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ステップ4 :個包装
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ステップ5 :梱包箱
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ステップ6 :バーコード配送タグ
すべての製品は静電気防止袋に梱包されます。 ESD 帯電防止保護を備えた状態で出荷されます。
社外の ESD 梱包ラベルには、部品番号、ブランド、数量などの当社の情報が使用されます。
私たちは出荷前にすべての商品を検査し、すべての製品が良好な状態であることを確認し、部品が新しいオリジナルでデータシートと一致していることを確認します。
すべての商品に問題がないことを確認した後、梱包後、安全に梱包し、グローバルエクスプレスで発送します。 優れた耐穿刺性と耐引裂性を示し、シールの完全性も良好です。
私たちは高品質の製品、思いやりのあるサービス、販売後の保証を提供します
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豊富な商品を取り揃えておりますので、お客様の様々なニーズにお応え致します。
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最小注文数量は1個からとなります。
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最低国際配送料は0.00ドルから
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全商品365日品質保証